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在俺们刚一初露接触到51单片机的时光对P0口务须累加上拉电阻,要不然P0就是高阻态。 对这个题材唯恐备感何去何从,为何是高阻态?累加拉电阻?今日针对性这一概念进行简单教课。 高阻态 高阻态这是一个数字电路里常见的歇后语,指的是电路的一种输出状态,既大过高电平也错事低电平。 一旦高阻态再输入下一级电路的话,对属下电路无其余潜移默化,和没接相同,万一用万用表测的话有可能是高电平也有可能是低电平,随它后身接的东西定。 高阻态的庐山真面目 电路分析时高阻态可做挖掘理解,你方可把它作为输出(输入)电阻十